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杰理芯片硬件設計注意事項


一、電源、地線

1、分 AGND 和 GND 二個地,AGND 在功放處或電池處和 GND 短接,可以消除共地引起的各種噪聲。

2、VDDIO、DACVDD 、RTCVDD 這幾個引腳輸出 3.3V,其中 VDDIO 帶負載能力強,可以用來給外部芯片供電;

VCOM 輸出 1.5V;布局時,C22/C23/C24/C25/C26 盡量靠近相應管腳;如下圖。

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3、VBAT 是電源引腳,輸入電壓不要超過 5V,如使用電池供電,要使用帶保護板的電池。

二、信號

1、晶振要靠近主控放置,走線不可以太長。晶振必須選擇,穩定性、一致性好,頻偏偏差:在 ±10PPM 以內;(推薦使用杰理配套晶振)。

2、RF 天線必須放置在板邊,嚴禁被 GND 包裹,且正反面不能有金屬器件,采用三面鏤空方式(上、左、右),頂層和底層都要鏤空,如下圖。

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三、預留升級測試點

1、開發設計時必須引出 VBAT、GND、DP、DM 四個升級測試點,其中AD15N系列預留VBAT PB9(UART_TRX) GND三個升級測試點,測試點位置需考慮方便治具的使用。(備注:大貨生產時,萬一出現軟件問題,在最壞的情況下,還可以通過治具進行芯片程序升級工作)。此項非常重要,設計過程中如有疑問請跟我們溝通確認;

四、 功放

1、MUTE 腳是功放靜音腳,接主控普通 IO 口控制。

2、AB/D 類引腳

(1)、有收音功能,該引腳接主控普通 IO 口,在收音模式 IO 輸出低電平,控制功放進 AB 類。在其他模式時,輸出高電平,控制功放進 D 類。

(2)、沒有收音功能,直接將該引腳拉高到 3.3V,控制在 D 類模式即可。

五、軟關機需要注意事項

1、ADKEY 按鍵,22K 電阻上拉必須接到 RTCVDD,待機功耗在 4UA 以內。不能上拉到 VDDIO。如果接到 VDDIO,待機功耗會有 70UA,這個是不能接受的。

2、軟關機項目,在測試過程中,一定要測試待機電流,這個非常重要。不然會存在待機時間短,長時間放置以后,開不了機。


聯系方式

地址:深圳市龍華區觀湖街道觀樂路5號多彩科創園B棟801

郵箱:steven@yunthinker.com

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